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01.Leakage Currents in an SRAM of Conventional Design;

02.Gate-Tunnel Leakage and GIDL Currents

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减少设计面积,意味着成本降低、功耗降低。特别是对于FPGA的设计,直接决定着FPGA的选型。

为了减少设计面积,首先得估算设计使用资源的数量,例如触发器、加法器、乘法器等。其中,触发器的数量由功能决定,很难减少,其面积也比较好估计。因此,RTL设计中的组合逻辑,对应的各种操作符在使用的时候应该加以重视。例如,加减法、乘除法以及条件语句中的比较运算。

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在SRAM中,读写操作是最基本的,为了保证读写功能可以正常实现,我们需要分开来分析测试读写操作的稳定性,本文便详细阐释了SRAM读写操作的电学稳定性。

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介绍SRAM基本存储单元,也分析了其设计和读写过程。

01.最常见的SRAM cell,the full CMOS 6T 类型;

02.SRAM的读写过程;

03.执行读操作时最基本的电学稳定**特性,静态噪声裕量(SNM)

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CMOS反相器的性能:动态特性


CMOS反相器的传播延时取决于它分别通过PMOS和NMOS管充放电负载电容CL所需要的时间。使CL尽可能小是实现高性能CMOS电路的关键。

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Verilog HDL 语言的特点

互连(connectivity):网络数据类型表示结构实体(例如门)之间的物理连接,不能存储值,由驱动器(例如门或连续赋值语句,assign)驱动。常见类型包括wire型和tri型。

并发(concurrency):可以有效地描述并行的硬件系统

时间(time):定义了绝对和相对的时间度量,可综合操作符具有物理延迟

可综合:always、if-else、case、assgin

不可综合:function、for、fork-join、while

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CMOS设计指标

设计指标:

  • 成本:用复杂性和面积来表示
  • 完整性和稳定性:用静态(即稳态)特性来表示
  • 性能:由动态(即瞬态)响应决定
  • 能量效率:由能耗和功耗决定
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GNU sed实例教程

sed (stream editor) is a non-interactive command-line text editor.

官方的定义是非交互地命令行文本编辑器。而我觉得描述成“行内文本插入、删除、替换的小工具“更容易理解。

说到”行内“,即以一行文本为单位进行处理。sed的工作模式如下图,读入一行文本到内部的buffer,执行处理文本命令,输出到屏幕。然后读入下一行文本,进行下一轮处理。

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